Différences
Ci-dessous, les différences entre deux révisions de la page.
Les deux révisions précédentes Révision précédente Prochaine révision | Révision précédente | ||
howtos:papilio_duo [2015/06/12 13:20] – hackens | howtos:papilio_duo [2022/05/05 07:40] (Version actuelle) – modification externe 127.0.0.1 | ||
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Ligne 2: | Ligne 2: | ||
===== Troubleshooting ===== | ===== Troubleshooting ===== | ||
+ | |||
+ | ==== Je n' | ||
+ | |||
+ | sudo modprobe cdc-acm | ||
+ | |||
+ | ==== L'AVR ne marche pas comme prévu ==== | ||
+ | |||
+ | Appuyer sur le bouton RESET du FPGA ne reset pas l'AVR ! | ||
+ | |||
+ | ==== L'AVR n' | ||
+ | |||
+ | Attention, sur le pinout, c'est pas parce qu'un pin a un numéro d' | ||
==== L'AVR s' | ==== L'AVR s' | ||
Ligne 58: | Ligne 70: | ||
Verilog est un langage puissant et certaines de ses fonctions (par exemple la division ou le délai (#)) ne sont pas synthétisables, | Verilog est un langage puissant et certaines de ses fonctions (par exemple la division ou le délai (#)) ne sont pas synthétisables, | ||
+ | |||
+ | ==== Le FPGA n' | ||
+ | |||
+ | Changer de cable | ||
+ | |||
+ | ==== Comment on flashe ? ==== | ||
+ | |||
+ | http:// | ||